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环亚集团PCB板设计需要提供的信息以及基本流程

时间:2020-11-05 04:12

  尺寸:提供定位装置的具体位置和方向识别,以及特定高度限位位置区域的识别;

  预备 ->

  PCB结构设计 ->

  布线优化和丝网 ->

  网络和DRC检查和结构检查 ->

  PCB板。

  1)这包括准备组件库和原理图。“如果你想做一些好事,你必须首先磨练你的工具。”为了建立一个好的董事会,除了设计原则,你必须画好。在继续PCB设计之前,必须首先准备原理图SCH的元件库和PCB的元件库(这是第一步 - 非常重要)。组件库可以使用Protel附带的库,但通常很难找到合适的库。最好根据所选设备的标准尺寸数据自行完成组件库。

  原则上,首先执行PCB的组件库,然后执行SCH的组件库。PCB元件库要求较高,它直接影响电路板安装; SCH组件库要求相对宽松,只要您注意定义引脚属性以及与PCB组件的对应关系。

  PS:注意标准库中的隐藏引脚。然后是原理图的设计,当它准备就绪时,就可以开始PCB设计了。

  2)在制作原理图的库时,要注意引脚是否连接到输出/输出PCB板并检查库。

  此步骤根据确定的板面尺寸和各种机械定位在PCB设计环境中绘制PCB表面,并放置所需的连接器,按钮/开关,数码管,指示器,输入,并根据定位要求输出。,螺丝孔,安装孔等,充分考虑和确定布线区域和非布线区域(如螺丝孔的范围是非布线区域)。

  应特别注意支付组件的实际尺寸(占用面积和高度),组件之间的相对位置 - 空间的大小,以及设备放置的表面,以确保电路板的电气性能。在生产和安装的可行性和便利性的同时,在确保能够体现上述原则的前提下,应对设备进行适当修改以使其整洁。如果相同的装置放置整齐并在同一方向上,它不能被放置。这是拼凑而成的。“

  2)布局应注意放置的表面设备(特别是插件等)和设备的放置方式(直插式水平或垂直放置),以确保安装的可行性和便利性。

  3)布局为白色将设备放在电路板上。此时,如果上述准备工作全部完成,您可以在原理图上生成网络表(Design->

  CreateNetlist),然后导入网络表(Design->

  LoadNets)在PCB上。我看到了完整的设备堆栈,并且引脚之间有飞线提示连接,然后可以进行设备布局。

  当我躺着的时候在布局中,您应该确定放置设备的表面:一般来说,补丁应放在同一侧,插件应该查看具体情况。

  1 )根据电气性能的合理划分,一般分为:数字电路区域(即干扰,干扰),模拟电路区域(怕干扰),电源驱动区域(干扰源);

  2)完成相同功能的电路,应尽可能靠近放置,并调整元件以确保最简单的连接;同时,调整功能块之间的相对位置,使功能块之间的连接最简洁;

  3)对于高质量的部件,应考虑安装位置和安装强度;加热元件应与温度敏感元件分开放置,必要时还应考虑热对流措施;

  接线是整个PCB设计中最重要的过程。这将直接影响PCB的性能。在PCB的设计过程中,布线一般有三个级别的划分:第一个是连接,然后是PCB设计的最基本要求。如果没有铺设线路,并且线路正在飞行,那么它将是一个不合格的板子。可以说它还没有开始。其次是电气性能的满意度。这是衡量印刷电路板合格性的指标。这是连接后,仔细调整接线,以达到最佳的电气性能,其次是美观。如果您的接线是连接的,那么就没有影响电器性能的地方了,但过去一瞥,有很多色彩鲜艳,色彩丰富,那么您的电气性能有多好,在别人看来还是一块垃圾。这给测试和维护带来了极大的不便。接线应整齐均匀,不应有规章制度。这些必须在确保电气性能和满足其他个性化要求的同时实现。

  1)在正常情况下,应首先布线电源线和地线,以确保电路板的电气性能。在这些条件范围内,尝试加宽电源和接地线宽度。接地线比电源线更好。它们的关系是:地线mm。最细的宽度可以达到0.05~0.07mm,电源线mm。对于数字电路PCB,可以使用宽地线形成环路,用于形成接地网(模拟电路的接地不能像这样使用));

  2)预先加工要求较高的线(如高频线),输入和输出端的边缘应避免相邻的平行,以避免反射干扰。如果需要,加上接地,两个相邻层的布线应相互垂直,并联易发生寄生耦合;

  3)振荡器外壳接地,时钟线应尽可能短,不能随处引用。在时钟振荡电路下方,特殊的高速逻辑电路部分应增加接地面积,不应采用其他信号线,以使周围电场接近零;

  4)尽可能使用45°折线°折线来减少高频信号的辐射; (要求高线)不要在任何信号线上形成环路。如果不可避免,环路应尽可能小;信号线的通孔数量应尽可能小;

  7)通过扁平电缆传输敏感信号和噪声场带信号时,应通过“地线信号 - 地线)应为测试点保留关键信号,以方便调试,生产和维护测试;

  9)完成示意布线后,应优化布线。同时,在初始网络检查和DRC检查正确之后,执行无线区域的接地,并且使用大面积铜层作为地线,并且使用印刷电路板。未使用的地方作为地面连接到地面。或者制作多层板,电源,地线.添加泪珠

  泪珠是垫与线之间或线与引导孔之间的滴水连接。设置泪滴的目的是当电路板受到大的外力时,避免导线与焊盘或导线和导向孔之间的接触点。另外,断开连接,泪滴的设置可以使PCB电路板看起来更漂亮。

  在电路板设计中,为了使焊盘更坚固,防止制作机械板时,焊盘与焊丝之间断裂,焊盘与焊丝之间通常会设置过渡带铜膜,形状像泪珠,因此通常称为泪珠。

  6.反过来,第一项检查是查看Keepout图层,顶层,底层topoverlay和底部覆盖。

  7.电气规则检查:通孔(0通孔 - 非常不可思议; 0.8边界线),是否有断开的网表,最小间距(10mil),短路(每个参数逐一分析)

  9.完成PCB后,重新加载网络标记以检查网表是否已被修改 - 它可以正常工作。

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  3 GHz典型 PECL模式工作范围:V CC = 3.0 V至5.5 V,V EE = 0 V NECL模式工作范围:V CC = 0 V,V EE = -3.0 V至-5.5 V 打开输入默认状态 输入的安全钳位 Q输出打开或V EE 时输出默认...发表于04-18 21:00•次阅读 -->

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  -2.5 V的相等电位,则接收器不会进入定义状态,而是正常差分放大器方式的电流共享,在高电平和低电平之间产生输出电压电平,或者器件甚至可能振荡。 V 引脚,内部产生的电压源,仅适用于此器件。对于单端输入条件,未使用的差分输入连接到V 作为开关参考电压。 V 也可以重新连接AC耦合输入。使用时,通过0.01 F电容去耦V 和VCC,并限制电流源或吸收至0.5 mA。不使用时,V 应保持打开状态。 100系列包含温度补偿。 500ps Max。传播延迟 V 电源输出 专用V 每个接收器的引脚 PECL模式工作范围:V = 4.2 V至5.7 V,V = 0 V NECL模式工作范围:V = 0 V当V = -4.2 V至-5.7 V 输出Q 将在输入 内部输入下拉电阻时默认为低电平 符合或超过JEDEC规范EIA / JESD78 IC闩锁测试 ESD保护:...发表于04-18 20:51•次阅读 -->

  16次 阅读ADN4668 3 V LVDS 四通道CMOS差分线接收器和特点 接收器输入引脚提供±15 kV ESD保护开关速率:400 Mbps(200 MHz)流通引脚配置简化印制电路板布线 ps(典型值) 差分偏移:100 ps(典型值) 传播延迟:2.7 ns(最大值)电源电压:3.3 V断电时具有高阻抗输出低功耗设计(待机功耗典型值为3 mW)可与现有的5 V LVDS驱动器配合使用接收小摆幅(典型值310 mV )差分输入信号电平支持开路、短路,以及终止输入故障安全 产品详情 ADN4668是一款四通道CMOS低压差分信号(LVDS)线 MHz)以上的数据速率及超低功耗。ADN4668具有流通引脚配置,可以轻松实现印制电路板布线以及输入信号与输出信号的分离。这款器件接收低压(典型值310 mV)差分输入信号,并将其转换为单端3 V TTL/CMOS逻辑电平。ADN4668还提供高电平有效和低电平有效的启用/禁用输入(EN 和/EN),以控制全部的4个接收器。它们可禁用接收器,并将输出切换为高阻抗状态。这个高阻抗状态允许对一个或多个ADN4668的输出进行多路复用,以将待机功耗降低至3 mW(典型值)。ADN4668及与其配合使用的驱动器ADN4667,可为高速点对点数据传输提供全新的解决...发表于02-22 13:39•次阅读 -->

  31次 阅读ADN4662 单通道、3 V、CMOS、LVDS差分线路接收器和特点 输入引脚提供±15 kV ESD保护转换速率:400 Mbps (200 MHz)直通式引脚排列可简化PCB布局传播延迟:2.5 ns(最大值)3.3 V 电源关断时为高阻抗输出与现有5 V LVDS驱动器兼容接受小摆幅(典型值310 mV)差分信号电平支持开路、短路和端接输入故障安全功能阈值区间:0 V至−100 mV符合TIA/EIA-644 LVDS标准工业温度范围:−40°C至+85°C 产品详情 ADN4662是一款单通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。它采用直通式引脚排列,便于PCB布局以及输入与输出信号分离。             该器件接受低压(典型值310 mV)差分输入信号,并将其转换为单端3 V TTL/ CMOS逻辑电平。ADN4662及其配套驱动器ADN4661为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。              应用点对点数据传输多分支总线时钟分配网络背板接收器 方框图...发表于02-22 13:30•次阅读 -->

  24次 阅读ADN4667 3 V LVDS四通道CMOS差分线驱动器和特点 输出引脚提供±15 kV ESD(静电放电)保护开关速率:400 Mbps (200 MHz)流通引脚排列简化印制电路板(PCB)布线 ps(典型值)差分偏移:400 ps(最大值)传播延迟:1.7 ns(最大值)电源电压:3.3 V 欲了解更多信息,请参考数据手册 产品详情 ADN4667是一款四通道CMOS低压差分信号(LVDS)线 Mbps以上的数据速率(200MHz)和超低功耗。它具有流通引脚,可以轻松实现印制电路板布局以及输入与输出信号的分离。 ADN4667接收低压TTL/CMOS逻辑信号,并将其转换为一个差分电流输出信号,来驱动双绞线等传输媒介,输出电流的典型值为±3.1 mA。传输信号在接收端的终端电阻上产生典型值为±310 mV的差分电压。然后再通过ADN4668等LVDS接收器转换为TTL/CMOS逻辑电平。ADN4667还提供高电平和低电平有效的使能/禁用输入(EN和/EN)。这些输入控制全部的4个驱动器,并在禁用状态关闭电流输出,以将待机功耗降低至10 mW(典型值)。ADN4667及与其配合使用的LVDS接收器ADN4668,可为高速点对点数据传输提供全新的解决方案,并为发射极耦合逻辑(ECL)或正电压射极耦合逻...发表于02-22 13:30•次阅读 -->

  26次 阅读ADN4664 双通道、3 V、CMOS、LVDS差分线路接收器和特点 输出引脚提供±15 kV ESD保护转换速率:400 Mbps (200 MHz)直通式引脚排列可简化PCB布局通道间偏斜:100 ps(典型值)传播延迟:2.5 ns(最大值)3.3 V电源关断时为高阻抗输出低功耗:3 mW(静态典型值)与现有5 V LVDS驱动器兼容接受小摆幅(典型值310 mV)差分信号电平支持开路、短路和端接输入故障安全功能阈值区间:0 V至−100 mV 产品详情 ADN4664是一款双通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。它采用直通式引脚排列,便于PCB布局以及输入与输出信号分离。该器件接受低压(典型值310 mV)差分输入信号,并将其转换为单端3 V TTL/ CMOS逻辑电平。              ADN4664及其配套LVDS驱动器ADN4663为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。          应用点对点数据传输多分支总线时钟分配网络背板接收器 方框图...发表于02-22 13:30•次阅读 -->

  124次 阅读ADN4665 3 V、LVDS、四通道、CMOS差分线路驱动器和特点 输出引脚提供±15 kV ESD保护转换速率:400 Mbps (200 MHz)差分偏斜:100 ps(典型值)差分偏斜:400 ps(最大值)传播延迟:2 ns(最大值)3.3 V电源差分信号:±350 mV低功耗:13 mW(典型值)与现有5 V LVDS接收器兼容关断时为高阻抗LVDS输出符合TIA/EIA-644 LVDS标准欲了解更多特性,请参考数据手册 产品详情 ADN4665是一款四通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。     该器件接受低压TTL/CMOS逻辑信号,并将其转换成典型值为±3.5 mA的差分电流输出,以便驱动双绞线电缆等传输介质。所传输的信号在接收端的端接电阻上产生典型值为±350 mV的差分电压,然后由LVDS接收器将其转换为TTL/CMOS逻辑电平。     ADN4665还提供高电平有效和低电平有效使能/禁用输入(EN和EN)。这些输入控制所有四个驱动器,并在禁用状态下关闭电流输出,将静态功耗降至典型值10 mW。ADN4665为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。         应用背板...发表于02-22 13:30•次阅读 -->

  26次 阅读SSM2141 高共模抑制差分线路接收器和特点 High Common-Mode RejectionDC: 100 dB typ60 Hz: 100 dB typ20 kHz: 70 dB typ40 kHz: 62 dB typ Low Distortion: 0.001% typ Fast Slew Rate: 9.5 V/µs typ Wide Bandwidth: 3 MHz typ Low Cost Complements SSM2142 Differential Line Driver产品详情 SSM2141是一款集成式差分放大器,用于接收平衡线路输入,适合要求高抗扰度和最佳共模抑制的音频应用。该器件的共模抑制(CMR)性能通常可以达到100 dB,而利用四个现有精密电阻的运算放大器实施方案,通常共模抑制只能达到40 dB,不能满足高性能音频的要求。SSM2141通过保持9.5 V/µs的高压摆率和高开环增益来实现低失真性能。在整个音频带宽内,其失线与平衡线互为补充。这些器件组合在一起可构成一个完全集成的解决方案,能够实现音频信号的等效变压器平衡,而不会有失真、电磁辐射(EMI)场和高成本等问题。SSM2141的其它应用包括信号求和、差分前置放大器和600 Ω低失真缓冲放大器。如需增益G = 1/2的类似性能器件,请参考SSM2143。 方框图...发表于02-22 13:08•次阅读 -->

  68次 阅读SSM2143 -6 dB 差分线路接收器和特点 高共模抑制 DC: 90 dB(典型值) 60 Hz: 90 dB(典型值) 20 kHz: 85 dB(典型值) 超低总谐波失线 kHz) 快速压摆率: 10 V/ms(典型值) 宽带宽: 7 MHz(典型值,G = 1/2) 提供两个增益级: G = 1/2或2 低成本 产品详情 SSM2143是一款集成式差分放大器,用于接收平衡线路输入,适合要求对共模噪声有高抗扰度的音频应用。该器件通过对电阻进行激光调整,使之达到优于0.005%的精度,从而实现典型值为90 dB的共模抑制(CMR)。                                    该器件的其它特性包括10 V/µs的压摆率和宽带宽。在整个音频频段内,总谐波失线%,即使驱动低阻抗负载时也是如此。SSM2143输入级设计用于处理高达+28 dBu的输入信号(G = 1/2)。虽然该器件主要针对G = 1/2的应用,但通过反接+IN/-IN和SENSE/REFERENCE,也可以实现2倍增益。采用增益为1/2的配置时,SSM2143与平衡线可提供全集成式单位增益解决方案,能够在长电缆上驱动音频信号。如需增益G = 1的类似性能器件,请参考SSM2141。 方...发表于02-22 13:08•次阅读 -->

  26次 阅读ADN4666 3 V、LVDS、四通道、CMOS差分线路接收器和特点 接收器输入引脚提供±8 kV ESD IEC 61000-4-2接触放电保护 转换速率:400 Mbps (200 MHz) 通道间偏斜:100 ps(典型值) 差分偏斜:100 ps(典型值) 传播延迟:3.3 ns(最大值) 3.3 V 电源 关断时为高阻抗输出 欲了解更多特性,请参考数据手册。产品详情 ADN4666是一款四通道、CMOS、低压差分信号(LVDS)线 MHz)以上的数据速率,功耗超低。     该器件接受低压(典型值350 mV)差分输入信号,并将其转换为单端3 V TTL/ CMOS逻辑电平。       ADN4666还提供高电平有效和低电平有效使能/禁用输入(EN和EN),用来控制所有四个接收器。这些输入可禁用接收器,将输出切换至高阻抗状态。因此,一个或多个ADN4666器件的输出可以多路复用,将静态功耗降至典型值10 mW。    ADN4666及其配套驱动器ADN4665为高速点对点数据传输提供一种新的解决方案,可以代替射极耦合逻辑(ECL)或正射极耦合逻辑(PECL),功耗则更低。   应用点对点数据传输多分支总线时钟分配网络背板接收器 方框图...发表于02-22 12:02•次阅读 -->

  159次 阅读INA1651 SoundPlus™™ 高共模抑制、低失真差分线(单通道)SoundPlus™音频线dB的超高共模抑制比(CMRR),同时对于22dBu信号电平可在1kHz时保持-120dB的超低THD + N.片上电阻器的高精度匹配特性为INA165x器件提供了出色的CMRR性能。这些电阻器具有远远优于外部组件的匹配特性,并且不受印刷电路板(PCB)布局所导致的失配问题的影响。不同于其他线x CMRR在额定温度范围内能保持特性不变,经生产测试可在各种应用中提供始终如一的性能。 INA165x器件支持±2.25V到±18V的宽电源电压范围,电源电流为10.5mA。除线路接收器通道之外,INA165x器件还包含一个缓冲的中间电压基准输出,因此可将其配置为用于双电源或单电源应用。中间电源输出可用作信号链中其他模拟电路的偏置电压。这些器件的额定温度范围为-40°C至125°C。 特性 高共模抑制: 91dB(典型值) 高输入阻抗:1MΩ差分 超低噪声:-104.7dBu,未加权 超低总谐波失线dB THD + N(22dBu,22kHz带宽) 高带宽:2.7MHz 低静态电流:6mA(INA1651,典型值) 短路保护 集成电磁干扰(EMI)滤波器 宽电源电压...发表于01-08 17:51•次阅读 -->

  114次 阅读INA1650 INA1650 SoundPlus™ 高共模抑制、低失真差分线 SoundPlus音频线dB的极高共模抑制比(CMRR),同时对于22dBu信号电平,可在1kHz下保持-120dB的超低1650这种优异的CMRR性能通过精确匹配片上电阻来实现,与外部组件相比,可提供更加卓越的匹配能力,并且不受印刷电路板(PCB)布局布线引入的不匹配干扰。不同于其他线 CMRR在额定温度范围内能保持特性,经生产测试可在各种应用中提供始终如一的性能。 INA1650支持±2.25 V到±18V的宽电源电压范围,电源电流仅为10.5mA.INA1650除了两个线路接收器通道外,还包括一个缓冲的中间电压基准输出,允许将其配置用于双电源或单电源应用。中间电源输出可用作信号链中其他模拟电路的偏置电压。 INA1650具备独特的内部布局,即使在过驱或过载条件下也可在通道间实现最低串扰和零交互。此器件的额定温度介于-40°C至+ 125°C之间。 特性 高共模抑制: 91dB(典型值) 高输入阻抗:1MΩ差分 超低噪声:-104.7dBu,未加权 超低总谐波失线dB THD + N(22dBu,22kHz带宽) 高带宽:2.7MHz 低静态电流:10.5mA(典型值) 短路保护 集成...发表于11-02 19:34•次阅读 -->

  24次 阅读SN65LBC175A-EP 四路 RS-485 差分线A-EP是一款具有三态输出的四通道差分线路接收器,专为TIA /EIA-485(RS-485),TIA /EIA-422(RS-422)和ISO 8482(Euro RS-485)应用而设计。 当数据速率高达甚至超过5000bps时,该器件针对均衡后的多点总线通信进行了优化。传输介质可采用双绞线电缆,印刷电路板走线或背板。最终数据传输速率和距离取决于介质衰减特性和环境噪声耦合。 接收器的正负共模输入电压范围较大,具有6kV ESD保护,非常适用于极端环境下的多点高速数据传输应用。这些器件通过LinBiCMOS进行设计,兼具低功耗特性和极强稳定性。 两个EN输入可实现成对的使能控制,也可在外部将二者连接在一起,用相同的信号使能全部四个驱动器。 特性 专为TIA /EIA-485,TIA /EIA-422和ISO 8482应用而设计 信号传输速率线路的信号传输速率是指每秒钟的电压转换次数,单位为bps(每秒比特数)。超出50Mbps 在总线短路,开路和空闲总线条件下提供故障保护 为总线输入提供的静电放电(ESD)保护电压超过6kV 共模总线V 传播延迟时间< ; 18ns 低待机流耗:< 32μA 针对MC3486,DS96F1...发表于11-02 19:02•次阅读 -->

  26次 阅读SN65LBC180-Q1 汽车类低功耗差分线路驱动器和接收器对SN65LBC180差分驱动器和接收器对是一种单片集成电路,设计用于通过长电缆进行双向数据通信,具有传输线的特性。它是一种平衡或差分电压模式设备,符合或超过行业标准ANSI RS-485和ISO 8482:1987(E)的要求。该器件采用TI的专有LinBiCMOS设计? CMOS低功耗以及同一电路中双极晶体管的精度和稳健性。 SN65LBC180将差分线 V单电源供电。驱动器和接收器分别具有高电平有效和低电平有效使能,可以在外部连接以用作方向控制。驱动器差分输出和接收器差分输入连接到单独的端子以进行全双工操作,并设计为向总线提供最小负载,无论是禁用还是断电(V CC = 0)。该器件具有宽共模电压范围,适用于点对点或多点数据总线应用。 该器件还提供正负输出电流限制和热关断,以防止出现问题。线路故障情况。线°C时关闭。 特性 汽车应用合格 专为通过长电缆传输高速多点数据而设计 使用脉冲持续时间低至30 ns 低电源电流。 。 。 5 mA Max 达到或超过ANSI标准RS-485和ISO 8482:1987(E)的要求 派对线总线的三态输出共模电压范围-7 V至12 V 热...发表于10-16 11:16•次阅读 -->

  16次 阅读FPC202 采用扩展 I/O 的双端口控制器FPC202 双端口控制器用作低速信号聚合器,适用于 SFP、QSFP 和 Mini-SAS HD 等通用端口类型。FPC202 能够跨两个端口聚合所有低速控制和 I2C 信号,并为主机提供一个易于使用的管理接口(I2C 或 SPI)。可以在高端口数情形中使用多个 FPC202 应用 中使用多个 FPC402,通过一个公共控制接口连接到主机。FPC202 所采用的设计允许将其放置在 PCB 底部、压合连接器下方,由此可简化布线。凭借这种本地控制端口低速信号的方法,可以使用 I/O 数更少的控制器件(FPGA、CPLD 和 MCU)并减少布线层拥塞,从而降低系统物料清单 (BOM) 成本。FPC202 能够与标准的 SFF-8431、SFF-8436 和 SFF-8449 低速管理接口(包括连接每个端口的专用 100/400kHz I2C 接口)兼容。该器件还提供有其他通用引脚来驱动端口状态 LED 或控制电源开关。LED 驱动器 具有 可编程闪烁和调光等便捷功能。连接主机控制器的接口可在 1.8V 至 3.3V 的单独电源电压下运行,以支持低压 I/O。对于每个端口,FPC202 总共具有四个 LED 驱动器、12 个通用 I/O 和两个下行 I2C 总线。这组扩展的 I/O 允许控制系统内的其...发表于10-16 11:16•次阅读 -->

  18次 阅读FPC401 四端口控制器FPC401四端口控制器用作低速信号聚合器,适用于SFP +,QSFP +和SAS等通用端口类型.FPC401能够跨四端口聚合所有低速控制和I2C信号,并为主机提供了一个方便使用的管理接口(I2C或SPI)。对于高端口数应用来说,可以搭配使用多个FPC401,而且同样能够为主机提供一个公共控制接口.FPC401所采用的设计允许放置在PCB底部的压合连接器下,这样方便布线。凭借这种本地控制端口低速信号的方法,可以使用IO数更少的控制器件(FPGA,CPLD,MCU)并减少布线层拥塞,从而降低系统物料清单(BOM)成本。 特性 支持跨四个端口进行控制信号管理和I2C聚合 结合多个FPC401可通过一个主机接口控制56个端口 无需使用分立式I2C多路复用器,LED驱动器和高引脚计数现场可编程门阵列(FPGA)/复杂可编程逻辑器件(CPLD)控制器件 通过处理接近端口的全部低速控制信号来降低PCB布线MHz)或SPI(高达10MHz)主机控制接口 从模块中自动预取用户指定的重要数据 单端口和多端口读/写延迟短:SPI模式<50μs,I2C模式<400μs 广播模式允许对所有FPC401控制器的全部端口...发表于10-16 11:16•次阅读 -->

  15次 阅读FPC402 FPC402 四端口控制器FPC402四端口控制器用作低速信号聚合器,适用于SFP,QSFP和Mini-SAS HD等通用端口类型.FPC402能够跨四个端口聚合所有低速控制和I2C信号,并为主机提供一个易于使用的管理接口(I2C或SPI)。您可以在高端口数应用中使用多个FPC402,通过一个公共控制接口连接到主机.FPC402所采用的设计允许放置在PCB底部,压合连接器下方,这样可以简化布线。凭借这种对端口中低速信号的本地控制方法,可以使用IO数更少的控制器件(FPGA,CPLD和MCU)并减少布线层拥塞,从而降低系统BOM成本。 FPC402能够与标准的SFF-8431,SFF-8436和SFF-8449低速管理接口(包括连接每个端口的专用100 /400kHz I2C接口)兼容。该器件还提供有其他通用引脚来驱动端口状态LED或控制电源开关.LED驱动器具有可编程闪烁和调光等便捷功能。连接主机制器的接口可以在1.8V至3.3V的单独电源电压下运行,以支持低压I /O. FPC402可以从每个模块中用户指定的寄存器中预取数据,这样方便主机通过一个快速I2C(速度高达1MHz)或SPI(速度高达10MHz)接口来访问数据。此外,当发生与受控端口相关联的用户可配置关键事件...发表于10-16 11:16•次阅读 -->

  26次 阅读SN75116 差分线路收发器这些集成电路设计用于TTL型数字系统和差分数据传输线之间的接口。它们对于派对线(数据总线)应用特别有用。这些电路类型中的每一种都在一个封装中组合了一个三态差分线路驱动器和一个差分输入线路接收器,两者都采用单个5V电源供电。驱动器输入和接收器输出兼容TTL。采用的驱动器类似于SN55113和SN75113三态线路驱动器,接收器类似于SN55115和SN75115线和SN75113驱动器以及SN55115和SN75115接收器的所有功能。驱动器在使能时执行双输入AND和NAND功能,或者在处于禁用状态时为负载提供高阻抗。驱动器输出级类似于TTL图腾柱输出,但是电流吸收部分与电流源部分分离,并且两者都被引出到相邻的封装端子。此功能允许用户选择在集电极开路输出配置中使用驱动器,或者通过将相邻的源和宿端子连接在一起,在正常的图腾柱输出配置中使用驱动器。 SN55116,SN75116和SN75118的接收器部分采用差分输入电路,共模电压范围为±15 V.内部130- 等效电阻,可选择用于端接传输线。频率响应控制端子允许用户降低接收器的速度或改善差分噪声抗扰度。 SN55116和SN75116的接收器具...发表于10-16 11:16•次阅读 -->